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Placa mãe ddr3 ddr3 w631gg6kb-12

w631gg6kb é classificado nas seguintes classes de velocidade: -11, -12, 12i, 12a, 12k -15, 15i,

15a e 15k. o grau de velocidade -11 é compatível com a especificação ddr3-1866 (13-13-13). o -12,

As classes de velocidade 12i, 12a e 12k são compatíveis com a especificação ddr3-1600 (11-11-11) (a versão 12i

classe industrial que é garantida para suportar -40 ° c ≤ tcase ≤ 95 ° c). -15, 15i, 15a e 15k

As classes de velocidade são compatíveis com a especificação ddr3-1333 (9-9-9) (a classe industrial 15i, que é

garantido suporte -40 ° c ≤ tcase ≤ 95 ° c).


  • Marca:

    Winbond
  • Detalhes do produto

descrição geral


o w631gg6kb é um sdram ddr3 de 1g bits, organizado como 8.388.608 palavras, 8 bancos e 16 bits. Este dispositivo atinge taxas de transferência de alta velocidade de até 1866 mb / s / pino (ddr3-1866) para vários

formulários. O w631gg6kb é classificado nas seguintes classes de velocidade: -11, -12, 12i, 12a, 12k -15, 15i, 15a e 15k. o grau de velocidade -11 é compatível com a especificação ddr3-1866 (13-13-13). as classes de velocidade -12,12i, 12a e 12k são compatíveis com a especificação ddr3-1600 (11-11-11) (a classe industrial 12i que é garantida para suportar -40 ° c ≤ tcase ≤ 95 ° c). as classes de velocidade -15, 15i, 15a e 15k são compatíveis com a especificação ddr3-1333 (9-9-9) (a classe industrial 15i que é garantida para suportar -40 ° c ≤ tcase ≤ 95 ° c).


a temperatura das peças do tipo automotivo, se oferecida, possui dois requisitos simultâneos: a temperatura ambiente (ta) ao redor do dispositivo não pode ser inferior a -40 ° c ou superior a + 95 ° c (para 12a e 15a), + 105 ° c (para 12k e 15k), e a temperatura da caixa (tcase) não pode ser menor que -40 ° c ou maior que + 95 ° c (para 12a e 15a), + 105 ° c (para 12k e 15k). as especificações do jedec exigem que a taxa de atualização dobre quando o tcase exceder + 85 ° c; isso também requer o uso da opção de atualização automática de alta temperatura. além disso, a resistência odt e a impedância de entrada / saída devem ser reduzidas quando o tcase é & lt; 0 ° C ou & gt; + 85 ° c.


o w631gg6kb foi projetado para obedecer aos seguintes principais recursos ddr3 sdram, como

número de cas publicado, latência de gravação programável de cas # (cwl), calibração zq, na terminação da matriz e

redefinição assíncrona. todas as entradas de controle e endereço são sincronizadas com um par de relógios diferenciais fornecidos externamente. as entradas são travadas no ponto cruzado dos relógios diferenciais (ck subindo e ck # caindo). todas as E / Ss são sincronizadas com um par diferencial dqs-dqs # de maneira síncrona de origem.


recursos


 fonte de alimentação: vdd, vddq = 1.5v ± 0.075v

Architecture arquitetura de taxa de dados dupla: duas transferências de dados por ciclo de clock

 oito bancos internos para operação simultânea

 arquitetura de pré-busca de 8 bits

Lat latência do cas: 6, 7, 8, 9, 10, 11 e 13

Modes modos burst length 8 (bl8) e burst chop 4 (bc4): fixos via registro de modo (sra) ou selecionáveis ​​on-the-fly (otf)

 ordenação programável de burst de leitura: sequencial intercalada ou mordidela

Str Estrobos de dados diferenciais e bidirecionais (dqs e dqs #) são transmitidos / recebidos com dados

 alinhado com os dados de leitura e alinhado com os dados de gravação

Align dll alinha transições dq e dqs com clock

Inputs entradas diferenciais de clock (ck e ck #)

 comandos inseridos em cada borda ck positiva, dados e máscara de dados são referenciados às duas arestas de um par estroboscópico de dados diferencial (taxa de dados dupla)

Cas publicou cas com latência aditiva programável (al = 0, cl-1 e cl-2) para melhorar a eficiência do comando, endereço e barramento de dados

Lat latência de leitura = latência aditiva mais latência cas (rl = al + cl)

Operation operação de pré-carregamento automático para rajadas de leitura e gravação

 atualização, atualização automática, atualização automática (asr) e atualização automática de matriz parcial (pasr)

Down desligamento pré-carregado e desligamento ativo

Mas máscaras de dados (dm) para gravação de dados

Lat latência programável de gravação cas (cwl) por frequência operacional

Lat latência de gravação wl = al + cwl

Register registrador multiuso (mpr) para leitura de uma sequência de bits de calibração de tempo do sistema predefinida

Support suporte de calibração de tempo no nível do sistema por meio de nivelamento de gravação e padrão de leitura mpr

 calibração zq para driver de saída e odt usando resistor de referência externo ao terra

Pin pino de redefinição assíncrona # para seqüência de inicialização de inicialização e função de redefinição

Termin terminação programável na matriz (odt) para pares de dados, máscara de dados e estroboscópio diferencial

Od modo odt dinâmico para melhorar a integridade do sinal e impedâncias pré-selecionáveis ​​de terminação durante

escreve

Size tamanho da página de 2k bytes

 interface: sstl_15

 embalado em bola wbga 96 (9x13 mm2

), usando materiais sem chumbo com rohs compatíveis


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